モデムコーデック RL5T882/RL5T882S

Rev.1.1/981027
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モデムコーデック
RL5T882/RL5T882S
■概要
RL5T882/RL5T882S は、低コストでモデムシステムを実現可能な 1 チップモデムコーデックです。
V.34 及び 56Kbps モデムアプリケーションをターゲットとしており、16bit オーバーサンプリングΣΔ D/A,
A/D を提供いたします。
低消費電力（電源電圧 3.0V 時の消費電力 21mW）、小型パッケージ（44pin LQFP, 10 x 10 mm/48pin LQFP, 7
x 7 mm）を実現しソフトモデム、カードモデム、スタンドアローンモデム等、各種モデム装置の AFE（アナ
ログフロントエンド）としてご使用いただけます。
■特長
・ V.34 及び 56Kbps モデム用アナログフロントエンド
・ 16bit オーバーサンプリングΣΔ D/A, A/D
・ サンプリング周波数 9.6KHz, 電源電圧 3V 時の最大 SN 比 83dB
・ 電源電圧 3V 時のダイナミックレンジ 90dB
・ サンプリング周波数及びオーバーサンプリングレートはプログラム可能
・ 直線位相デジタルフィルタ採用
・ バンドギャップ基準電圧回路内蔵
・ プログラム可能なアッテネータ（0dB, -6dB, -∞）内蔵の差動出力
・ プログラム可能な増幅回路（0dB, 6dB）内蔵の 2 系統の差動入力
・ 16bit 同期式シリアルインターフェース
・ 4 本の汎用 I/O ポート
・ 3.0V 動作時消費電力 21mW
・ 3.0V パワーダウンモード時消費電力 3uW
・ 単一電源電圧 2.7 V ∼ 3.6V
・ RL5T882 : 44 ピン LQFP （10 x 10 mm）
・ RL5T882S : 48 ピン LQFP （7 x 7 mm）
■アプリケーション分野
・PDA 等の携帯情報端末
・PC カードモデム
・各種モデム装置
等
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− 1 −
■ブロック図
TEST TDOUT TDIN
DVDD DGND
HC1
HC0
AUXINP
DOUT
AUXINN
ANALOG
SIGMA-DELTA
MODULATOR
MUX
INP
DIGITAL
DECIMATION
FILTER
DIN
TSTD1
INN
SERIAL
PORTS
&
CONTROL
VREFP
VCM
BAND GAP
VOLTAGE
REFERENCE
SDFS
SDCLK
VREFN
MCM
DAC
1 bit
(1st Order
Differential
SC Filter)
OUTP
DIGITAL
SIGMA-DELTA
MODULATOR
INTERPOLATION
FILTER
MS
TS
OUTN
CLOCK
GENERATOR
GPIO[0:3]
GPIO
REG.
GPEN
AVDD
AGND1
AGND2
XTALOUT XTALIN
RESET_B
PDOWN_B
■主な仕様
◎ クロックジェネレータ
V.34 及び 56Kbps モデムで必要な下表サンプリング周波数をサポートしています。
クロックは全てマスタクロック（水晶直付け又は外部クロックジェネレータからの入力）から内蔵クロッ
クジェネレータにより生成します。オーバーサンプリング周波数は 2.304MHz 固定でマスタクロックを
1/16, 1/8, 又は 1/4 分周して使用します。
なお、リセット時のデフォルトサンプリング周波数は 9.6KHz となっています。
Symbol
Rates
Fmclk=36.864MHz
Fs(kHz)
(V.34)
レジスタ設定
M
Q
O
Fmclk=18.432MHz
内部分周比
MD
レジスタ設定
OR
M
Q
O
4.5
Fmclk=9.216MHz
内部分周比
MD
レジスタ設定
内部分周比
OR
M
Q
O
128
144
1
6
96
MD
144
OR
-
16.00
3
6
128
144
2
3429
13.71
3
7
128
168
1
7
192
168
1
7
96
168
3200
12.80
3
6
160
180
2
4.5
160
180
1
4.5
160
180
3000
12.00
3
8
128
192
2
6
128
192
1
6
128
192
2743
10.97
3
7
160
210
1.5
7
160
210
0.75
7
160
-
10.47
4
5.5
160
220
2
5.5
160
220
1
5.5
160
3429
10.29
4
7
128
224
2
7
128
224
1
7
128
224
3200, 2400
9.60
4
6
160
240
2
6
160
240
1
6
160
240
3000
9.00
4
8
128
256
2
8
128
256
1
8
128
256
-
8.86
4
6.5
160
260
2
6.5
160
260
1
6.5
160
260
2743
8.23
4
7
160
280
2
7
160
280
1
7
160
280
-
8.00
4
6
192
288
2
6
192
288
1
6
192
288
2400
7.20
4
8
160
320
2
8
160
320
1
8
160
320
16
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12345
− 2 −
8
210
4
220
◎アナログ入力＆A/D コンバータ
アナログ入力はマルチプレクサ（主入力又は AUX 入力）を介して、0dB 又は 6dB のゲイン調整が可能な
プログラマブルゲイン部へ入力されます。内部アナログ回路はデジタル信号に変換されるまで差動回路と
なっています。
◎D/A コンバータ＆アナログ出力
D/A コンバータは１次 SCF(Switch-Capacitor-Filter)で構成され、最終出力段で 0dB, -6dB, -∞のゲイン調整が
可能です。
◎ホストインターフェース
ホストインターフェースは、シリアルデータクロック（SDCLK）、シリアルデータ同期信号（SDFS）、
データ入力（DIN）、データ出力（DOUT）で構成されるシリアル I/F です。データは 2 の補数、MSB
ファーストで送受信されます。
A/D, D/A コンバータのチャネルデータのみの伝送、或はチャネルデータ及びコーデックを制御するコント
ロールデータの伝送はソフトウェア或はハードウェアで設定可能です。
◎汎用ポート
シリアル I/F から制御できる 4 本の汎用 I/O ポートを持っています。
33
32
31
30
29
28
27
26
25
24
23
NC
NC
AGND2
VCM
AVDD
IN N
IN P
AUXINN
AUXINP
NC
NC
G PIO 3
G PIO 2
SD C LK
SD FS
DVDD
DGND
MCM
XTA LO
XTA LI
RSRV D
G PIO 1
NC
1
2
3
4
5
6
7
8
9
10
11
12
36
35
34
33
32
31
30
29
28
27
26
25
NC
NC
NC
AGND2
VCM
AVDD
IN N
IN P
AUXINN
AUXINP
NC
NC
13
14
15
16
17
18
19
20
21
22
23
24
12
13
14
15
16
17
18
19
20
21
22
1
2
3
4
5
6
7
8
9
10
11
G PIO 0
TD IN
HC 1
HC 0
PDOWN_B
MS
VREFP
VREFN
AGND1
NC
NC
NC
G PIO 0
TDIN
HC 1
HC 0
PDO W N _B
MS
V REFP
V REFN
AGND1
NC
NC
G PIO 3
G PIO 2
SD C LK
SD FS
DVDD
DGND
MCM
XTA LO
XTA LI
RSRV D
G PIO 1
48
47
46
45
44
43
42
41
40
39
38
37
44
43
42
41
40
39
38
37
36
35
34
NC
G PEN
TD O U T
DOUT
DIN
TEST
TS
RESET_B
O UTN
O UTP
NC
NC
G PEN
TD O UT
DOUT
DIN
TEST
TS
RESET_B
O UTN
O UTP
NC
NC
■端子配置図
RL5T882 (LQFP44)
RL5T882S (LQFP48)
12345
12345
− 3 −
■アプリケーション例
SERIAL
PORT
RL5T882/
RL5T882S
INP
INN
DAA
OUTP
OUTN
HOST
DSP
12345
12345
− 4 −
PSTN
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1995 年 6 月
株式会社リコー
電子デバイス事業部 電子デバイス事業部
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@
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